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74ls90是多少计数器,74LS290和74LS90有什么具体的区别

来源:整理 时间:2023-10-10 14:14:10 编辑:亚灵电子网 手机版

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1,74LS290和74LS90有什么具体的区别

74LS290和74LS90都是二分频,五分频十进制计数器,功能相同,74LS290改变了引线排列.引线脚排列不同.

74LS290和74LS90有什么具体的区别

2,74ls90是什么类型的计数器异步清零和同步清零的区别是什么

异步计数器。74LS90是二,五,十进制异步计数器,计数器的异步清零可以不顾时钟信号,只要清零信号到来就进行清零操作。计数器同步清零即使清零信号有效也要等时钟信号有效沿到来时才清零,这就是两者之间的区别,

74ls90是什么类型的计数器异步清零和同步清零的区别是什么

3,74LS90计数器的问题

7490是二-五-十进制异步计数器,你要做八进制的就先把7490接成十进制的(CP1与Q0接,以CP0做输入,Q3做输出就是十进制的),然后用异步置数跳过一个状态达到八进制计数.以从000计到111为例.先接成加法计数状态,在输出为1000时(既Q4为高电平时)把Q4输出接到R01和R02脚上(即异步置0),此时当计数到1000时则立刻置0,从新从0开始计数.1000的状态为瞬态.状态转化图中是0000到0111是有效状态,1000是瞬态,跳转从这个状态跳回到0000状态.

74LS90计数器的问题

4,用74ls90设计六进制计数器

计数的对应输出 Q2、Q1、Q0,是000--101 共6个数,在计数到 110 时产生清零信号;利用反馈清零法即可。74LS90是二-五-十进制异步加法计数器,具有双时钟输入,并具有清零和置数等功能,其引脚排列如上图。设计采用反馈清零的方法实现,即从0记到要设计的进制时使清零端R0(1)、R0(2有效(同时为高电平,进而反馈清零。扩展资料:计数器一般来说,计数器主要由触发器组成,用以统计输入计数脉冲CP的个数。计数器的输出通常为现态的函数。计数器累计输入脉冲的最大数目称为计数器的“模”,用M表示。如M=6计数器,又称六进制计数器。所以,计数器的“模”实际上为电路的有效状态数。同步七进制加法计数器的逻辑图计数器的种类很多,特点各异。主要分类如下:按计数进制可分为:二进制计数器、十进制计数器、任意进制计数器。按计数增减可分为:加法计数器、减法计数器、加/减计数器,又称可逆计数器。按计数器中触发器翻转是否同步可分为:异步计数器和同步计数器。参考资料来源:百度百科-时序逻辑

5,74LS90是几分频器

74LS90是十进制异步计数器,内置2、5分频器和控制电路,可做2、5、10分频。http://wenku.baidu.com/view/80c263d1b14e852458fb5710.htmlhttp://wenku.baidu.com/view/6ccea8758e9951e79b8927c5.html
图太小,看不清楚!应该是74ls90吧。下面的是与门不过你可以把示波器分别接到每个90上的输出。。。看看结果,再分析,应该能找到原因!我分析是下面的与门的问题

6,计数器电路74ls90怎么分析几进制

(一)74LS90简介  74LS90是二-五-十进制异步加法计数器,具有双时钟输入,并具有清零和置数等功能,其引脚排列如图1所示。 ?  图中  R0(1)、R0(2) 为清零端,两者同时为高电平时实现清零功能,清零方式为异步。  R9(1)、R9(2)为置数端,两者同时为高电平时实现置数功能,此时,输出端输出1001。  QD、QC、 Q B、 Q A为数据输出端。 CP1、CP2为脉冲输入端,其中:  脉冲从CP1进去,输出从QA输出时为二进制记数  脉冲从CP2进去,输出从QD、QC、QB输出时为五进制记数 脉冲从CP1进去,QA接CP2,输出从QD、QC、QB、QA输出时为十进制记数,因此,  74LS90接成十进制记数方式时的电路如图2。  (二)设计方法  设计采用反馈清零的方法实现,即从0记到要设计的进制时使清零端 R0(1)、R0(2 有效(同时为高电平),进而反馈清零。具体的方法是:如需设计n进制计数器,就把n各位BCD码中为“1”的输出端进行“与”运算,结果接到各个74LS90的R0(1)、R0(2)端,即可实现n进制计数。(因为74LS90是异步清零方式,所以设计n进制计数器则需计到n的BCD码才能返回清零,而不是计到n-1就返回,实际上n只会一闪即失,并不能看到)  (三)实例应用  设计一36进制计数器  分析:两位数需用2块74LS90,首先将每块接成10进制构成100进制计数器,然后设计计数到36返回清零。36的BCD码为00110110,因此可将十位的QB、QA,个位的QC、QB相“与”,结果接到2块74LS90的清零端。电路:如图3所示。  ?  设计一360进制计数器  分析:需用3块74LS90,360的BCD码为001101100000,因此可将百位的QB、QA,十位的QC、QB相“与”,结果接到3块74LS90的清零端。(也可将个位的74LS90按图2接) 电路:如图4所示。 ?  1.设计n进制计数器,n为几位数就需几块74LS90。  2.每块74LS90的两脉冲都按10进制接法接,置数端无效。  3.高位的计数脉冲来自低位的QD。  4.n中为0的那位对应的74LS90的清零端可接n各位BCD码中为“1”的输出端的“与”运算结果,也可接低电(图2接法)

7,只用74LS90实现七进制计数器

这个很简单啊,QA、QB、QC、QD接输出,R9(1)R9(2)其中一个接低电平,另一个随便,然后将输出脚的QA、QB、QC接在一个三输入的与非门的输入端,与非门的输出端接在一个反相器的输入端,反相器的输出端接在R0(1)和R0(2)上面,也就是说,R0(1)和R0(2)短接,这样输出端就可以从0-6的变化了(0000(0) 0001(1) 0010(2) 0011(3) 0100(4) 0101(5) 0110(6) 0111(7)),当输出端的A、B、C同时为1时,与非门输出才为0,反相器输出为1,然后R0(1)和R0(2)同时为1,把输出端置零。这种方法好像叫做什么反馈清零法望采纳

8,关于74LS90的

出现这种情况主要是由于在清零时 部分输出端清零不可靠 未全部清零或清零过快 这时可以试着加个与非门缓冲器增加延迟 达到可靠清零
7490是二-五-十进制异步计数器,你要做八进制的就先把7490接成十进制的(CP1与Q0接,以CP0做输入,Q3做输出就是十进制的),然后用异步置数跳过一个状态达到八进制计数. 以从000计到111为例.先接成加法计数状态,在输出为1000时(既Q4为高电平时)把Q4输出接到R01和R02脚上(即异步置0),此时当计数到1000时则立刻置0,从新从0开始计数.1000的状态为瞬态. 状态转化图中是0000到0111是有效状态,1000是瞬态,跳转从这个状态跳回到0000状态.
74ls90的mr1.mr2管脚同时置一时,可实现异步清零。所以对2进制,最大显示数为1,q1接mr1。mr2即可;3进制,q1q2接mr1mr2;四进制,q2接mr1mr2;五进制,q0q2接mr1mr2;六进制,q1q2接mr1mr2;七进制不可;八进制,q3接mr1mr2;九进制q3q0接mr1mr2

9,如何利用74LS90接成50进制计数器

第一片74LS90采用10进制计数模式,clka是时钟信号输入端(下降沿有效),Q3、Q2、Q1、Q0是输出8421BCD码,计数值由0(0000)到9(1001)。第二片采用5进制计数模式,clkb是时钟输入(下降沿有效),Q3、Q2、Q1是输出(Q0可以不接),计数值由0(Q3Q2Q1:000)到4(Q3Q2Q1:100)。 下图中4072是4输入的或门,4072的输出为Q3+Q2+Q1+Q0,即只有当计数到”0000“时4072的输出才为低电平0,其他情况4072的输出为高电平1。当第一片74LS90计数到9(1001)时4072的输出为1,再来一个CLK下降沿第一片74LS90计数值为0,072的输出由高电平1变到低电平0,相当于给第二片74LS90一个CLK下降时钟信号,第二片74LS90计数值加1。两片计数值由0到49,50个数,实现了50进制。 下图是仿真图,你在对应加上电源和地接线就行了,若没有4072你也可以用2输入的或门,只要能实现Q3+Q2+Q1+Q0的结果接到第二片的时钟信号端CLKB(1脚)就行。
50进制 10*5 的 采用异步清零
第一片74LS90采用10进制计数模式,clka是时钟信号输入端(下降沿有效),Q3、Q2、Q1、Q0是输出8421BCD码,计数值由0(0000)到9(1001)。第二片采用5进制计数模式,clkb是时钟输入(下降沿有效),Q3、Q2、Q1是输出(Q0可以不接),计数值由0(Q3Q2Q1:000)到4(Q3Q2Q1:100)。 下图中4072是4输入的或门,4072的输出为Q3+Q2+Q1+Q0,即只有当计数到”0000“时4072的输出才为低电平0,其他情况4072的输出为高电平1。当第一片74LS90计数到9(1001)时4072的输出为1,再来一个CLK下降沿第一片74LS90计数值为0,072的输出由高电平1变到低电平0,相当于给第二片74LS90一个CLK下降时钟信号,第二片74LS90计数值加1。两片计数值由0到49,50个数,实现了50进制。 下图是仿真图,你在对应加上电源和地接线就行了,若没有4072你也可以用2输入的或门,只要能实现Q3+Q2+Q1+Q0的结果接到第二片的时钟信号端CLKB(1脚)就行。
一片74ls90最大是10进制计数器,不能接成接成16进制计数器,需要两片才可以。这点麻烦了,用一片74ls161就行了,就是16进制计数器。

10,用74ls90实现同步模10计数器

163属于同步清零,故构建十进制计数器的反馈归零要点是应按照1001即9来接。
<p>我觉得这里应该没有人能回答你这个问题了,我建议你去一些电子电路的论坛问问了。</p> <p>不过这里给你一些参考了。</p> <p>74ls48的输入端是四位二进制信号(8421bcd码),a、b、c、d、e、f、g是七段译码器的输出驱动信号,高电平有效。可直接驱动共阴极七段数码管, 是使能端,起辅助控制作用。<br>使能端的作用如下:<br>(1) lt是试灯输入端,当 lt=0, bi=1时,不管其它输入是什么状态,a~g<br>七段全亮;<br>(2)bi静态灭灯输入 ,当 bi=0,不论其它输入状态如何,a~g均为0,显示管熄灭;<br>(3)rbi动态灭零输入 ,当 lt=1, rbi=0时,如果 a3a2a1a0(abcd)=0000时,a~g均为各段熄灭;<br>(4) rbo动态灭零输出 ,它与灭灯输入bi 共用一个引出端。当 在动态灭零时输出才为0。片间与 rbi配合,可用于熄灭多位数字前后所不需要显示的零。<br>引脚图: <a href="http://wenwen.soso.com/z/urlalertpage.e?sp=shttp%3a%2f%2fwww.powerproduct.com%2fblog%2fmore.asp%3fuserid%3d280624%26blogid%3d21825" target="_blank">http://www.powerproduct.com/blog/more.asp?userid=280624&blogid=21825</a><br><br>74ls90计数器是一种中规模二一五-十进制计数器,r0(1),r0(2)是清零端,r9(1),r9(2)是置9端,cpa和qa可组成一个二进制计数器,cpb和qbqcqd组成五进制计数器;若把qa和cpb相连,脉冲从cpa输入,则构成8421bcd码十进制计数器。<br>引脚图: <a href="http://wenwen.soso.com/z/urlalertpage.e?sp=shttp%3a%2f%2fhi.baidu.com%2fshanghexiangyu%2fblog%2fitem%2f986a748134ad8cdfbd3e1ee0.html" target="_blank">http://hi.baidu.com/shanghexiangyu/blog/item/986a748134ad8cdfbd3e1ee0.html</a></p> <p> </p> <p>我就不是很明白了,不过如果你是学电子的应该会明白的。</p>
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