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fpga的高电平多少，想为fpga接入一个时钟不知道时钟的输出幅值应该是多大了也就是

来源：整理时间：2023-03-30 07:19:23 编辑：亚灵电子网手机版

1，想为fpga接入一个时钟不知道时钟的输出幅值应该是多大了也就是

具体看你的FPGA的VCCIO供电电压是多少了。一般晶振供电应和这个电压一样。使用4脚晶体振荡器比较好。

想为fpga接入一个时钟，不知道时钟的输出幅值应该是多大了，也就是输出的高电平是多少，

想为fpga接入一个时钟不知道时钟的输出幅值应该是多大了也就是

2，fpga输出电平

FPGA的端口输出电平大都为0~3.3V的，升压复杂降压容易，在需要输出0~1.8V的输出端口上，设计上两个分压电阻就行了：220Ω+270Ω=490Ω，3.3V*270/490≈1.82V。

fpga的io输出电平是可变的，通常3.3v是上限，在分配pin assignment的时候有关于io电压标准的配置选项。种类繁多，不同系列支持的种类也不同，具体请翻器件手册或者开发工具的pin约束软件。

fpga输出电平

3，fpga输出高电平准确为几V

查手册V(OH)。在负载合理范围内，视供电电压不同而不同，视端口类型不同而不同。一般3.3V供电，最常见的通用IO口（CMOS工艺），手册写端口输出高电平最低为1.9V，实际一般测量大多是2V多一点。还有些特殊端口是VCC-0.4V。

5v再看看别人怎么说的。

FPGA的IO输出电平是可变的，通常3.3v是上限，在分配Pin assignment的时候有关于IO电压标准的配置选项。种类繁多，不同系列支持的种类也不同，具体请翻器件手册或者开发工具的pin约束软件。

3.3V.不过基本上都用低电平有效（驱动能力强）。

fpga输出高电平准确为几V

文章TAG：fpga的高电平多少fpga 高电平多少

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