n个输入端的与门可以多少个，在VHDL语言中我要利用quartus软件中的而输入与门模块构成多输

来源：整理时间：2023-01-20 14:29:29 编辑：亚灵电子网手机版

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1，在VHDL语言中我要利用quartus软件中的而输入与门模块构成多输
2，将与非门的所有输入端连在一起可以实现什么门的功能
3，数字电路门电路可以有多个输入端
4，逻辑电路的与门可以只有一个输入端吗
5，门电路比如与门是怎样输出一个数的呢过程是怎样的

1，在VHDL语言中我要利用quartus软件中的而输入与门模块构成多输

直接用信号赋值语句y <= in1 AND in2 AND in3 AND in4;就可以描述4输入端与门，亦可以推广到n输入端与门。

我不会~~~但还是要微笑~~~：）

在VHDL语言中我要利用quartus软件中的而输入与门模块构成多输

2，将与非门的所有输入端连在一起可以实现什么门的功能

输入端相连，即输入端只要有一个是高电位，那么三个输入端都变成高电位，即与门变成或门，与非门变成或非门

根据真值表来接。与非门、或非门可以简单的将输入全部连在一起，异或门需要将多余的输入接“1”。与非门也可以把多余的输入接“1”，或非门也可以把多余的输入接“0”。

将与非门的所有输入端连在一起可以实现什么门的功能

3，数字电路门电路可以有多个输入端

理论上与门、或门，可以有无数个输入端；F = ABCDEFGH......；F = A+B+C+D+E+......；而现实中，尤其是集成电路，其输入端是有限的，可以用多个电路来组合；F = ABCDEFGH...... = （ABC）（DE）（FGH......）；F = A+B+C+D+E+...... = （A+B）+（C+D+E）+......；

0就是接低电平，电路中也叫接地;1就是接高电平，也就是接正电源，数字电路多数是5v，希能帮到你!

数字电路门电路可以有多个输入端

4，逻辑电路的与门可以只有一个输入端吗

另一个输入端需要上拉或者下拉，总之不能悬空，否则悬空的引脚状态不稳定，这个逻辑就变得没有意义了。或者还有一种用法就是两个输入端接一个信号，把这个与门当一个传输门用，通常是为了延迟信号的相位或者是增大输出能力。

c ab00“或门”则输出0，c0“非门”输出1。最终“与门”输出0 ab00“或门”则输出0，c1“非门”输出0。最终“与门”输出0 ab01“或门”则输出1，c0“非门”输出1。最终“与门”输出1 ab01“或门”则输出1，c1“非门”输出0。最终“与门”输出0 ab10“或门”则输出1，c0“非门”输出1。最终“与门”输出1 ab10“或门”则输出1，c1“非门”输出0。最终“与门”输出0 ab11“或门”则输出1，c0“非门”输出1。最终“与门”输出1 ab11“或门”则输出1，c1“非门”输出0。最终“与门”输出0所以c对。

5，门电路比如与门是怎样输出一个数的呢过程是怎样的

设与门的输入为：A，B ；与门的输出为：Y，那么与门的输出Y与输入：A、B的关系为： Y = AB (A乘以B)A、B、Y的取值为：（0，1）。与门电路的真值表为： Y A B 0 0 0 0 0 1 0 1 0 1 1 1即：A、B都为1（高电位）时，与门的输出才有：Y=1，否则：Y=0.

与门相当于乘法当前面所有的条件都符合才为1

嘿嘿，我研究了一种很容易的方法。16是个完全平方数，我假设你不知道16的平方根。方法是这样的：先把16分解质因数，16=2*2*2*2，16的质因数有四个2，就把这4个2平均分成两份，每份有两个2。这样就求出了16的平方根：16=（2*2）*（2*2），再把括号里的2*2求出来，所以16=4*4。是不是很容易？或许你还不明白方法。再举一个例子，144是一个完全平方数，我也假设要求144的平方根。像上面那样，先把144分解质因数。144=2*2*2*2*3*3，好了，144的质因数有4个2，两个3，我又把这些质因数平均分成两份，每份各有两个2，一个3。这样，144=（2*2*3）*（2*2*3），再把括号中的数算出来，144=12*12。*是乘号的意思。